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【崗位職責(zé)】 1、系統(tǒng)設(shè)計與開發(fā)：負(fù)責(zé)基于Xilinx ZYNQ系列芯片的嵌入式系統(tǒng)軟硬件方案設(shè)計、代碼開發(fā) 2、PL端開發(fā)：使用Verilog/VHDL進(jìn)行FPGA邏輯開發(fā)，包括IP核的設(shè)計、集成和仿真（如AXI總線接口、自定義外設(shè)、高速數(shù)據(jù)采集與處理邏輯等） 3、PS端開發(fā)：ZYNQ（PS）的軟件開發(fā)，編寫外設(shè)驅(qū)動程序（DMA, I2C, SPI, UART等） 4、軟硬件協(xié)同：主導(dǎo)PS和PL之間的協(xié)同設(shè)計與調(diào)試，實(shí)現(xiàn)高效的軟硬件數(shù)據(jù)交互（通過AXI-Lite, AXI-Stream, AXI-Full等接口） 5、系統(tǒng)調(diào)試與優(yōu)化：使用示波器、邏輯分析儀、SDK/Vitis等工具進(jìn)行系統(tǒng)級調(diào)試，解決硬件和軟件問題 【任職要求（必備技能）】 1、本科及以上學(xué)歷，電子工程、通信工程、計算機(jī)科學(xué)、自動化等相關(guān)專業(yè) 2、 3年以上嵌入式開發(fā)經(jīng)驗(yàn)，其中至少1年專注于Xilinx ZYNQ開發(fā) 3、精通Verilog或VHDL語言，具有扎實(shí)的數(shù)字電路基礎(chǔ) 4、熟悉Xilinx Vivado開發(fā)流程，能夠獨(dú)立完成從創(chuàng)建工程、綜合、實(shí)現(xiàn)到生成Bitstream的全過程 5、深刻理解AXI總線協(xié)議，并有基于AXI接口的IP核開發(fā)或集成經(jīng)驗(yàn)。 6、熟悉ZYNQ PS端的開發(fā)環(huán)境（PetaLinux, Vitis, SDK）