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崗位職責(zé)：
1.負(fù)責(zé)芯片數(shù)字后端全流程設(shè)計(jì)，包括Floorplan（布局規(guī)劃）、Power Plan（電源規(guī)劃）、Placement（單元布局）、CTS（時(shí)鐘樹綜合）、Routing（布線）等關(guān)鍵環(huán)節(jié)。
2.開展物理驗(yàn)證工作，使用相關(guān)工具進(jìn)行DRC（設(shè)計(jì)規(guī)則檢查）、LVS（版圖與原理圖一致性檢查）、ERC（電氣規(guī)則檢查）等。
3.進(jìn)行時(shí)序分析與優(yōu)化，基于靜態(tài)時(shí)序分析（STA）工具，分析時(shí)序瓶頸，通過調(diào)整布局、優(yōu)化時(shí)鐘樹等方式解決時(shí)序違例，確保芯片滿足時(shí)序要求。
4.與前端設(shè)計(jì)、驗(yàn)證、物理實(shí)現(xiàn)等團(tuán)隊(duì)緊密協(xié)作，理解設(shè)計(jì)需求和約束條件，反饋后端設(shè)計(jì)中的問題并協(xié)同解決，推動(dòng)項(xiàng)目順利進(jìn)行。
5.編寫后端設(shè)計(jì)相關(guān)文檔，包括設(shè)計(jì)報(bào)告、流程規(guī)范等，記錄設(shè)計(jì)過程和關(guān)鍵參數(shù)，為后續(xù)項(xiàng)目提供參考。
任職要求：
1.微電子、集成電路、電子工程等相關(guān)專業(yè)本科及以上學(xué)歷，3年以上芯片數(shù)字后端設(shè)計(jì)經(jīng)驗(yàn)，具有28nm CMOS數(shù)字后端設(shè)計(jì)與工程投產(chǎn)經(jīng)驗(yàn)。
2.熟悉數(shù)字后端設(shè)計(jì)流程，掌握Synopsys IC Compiler、Cadence Innovus等布局布線工具，以及PrimeTime等時(shí)序分析工具。
3.具備良好的時(shí)序分析、功耗優(yōu)化和物理問題解決能力。
4.具備良好的問題解決能力和團(tuán)隊(duì)協(xié)作精神，能夠高效工作，善于溝通與協(xié)調(diào)，確保項(xiàng)目的順利推進(jìn)。