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崗位職責(zé)：
1.承擔(dān)模擬芯片的版圖設(shè)計工作，依據(jù)電路原理圖，運(yùn)用專業(yè)工具精心繪制版圖，確保版圖布局合理、線路清晰，滿足芯片性能和工藝要求。
2.嚴(yán)謹(jǐn)細(xì)致地進(jìn)行版圖物理驗證，熟練使用Calibre等工具開展DRC（設(shè)計規(guī)則檢查）、LVS（版圖與原理圖一致性檢查）等驗證工作，及時發(fā)現(xiàn)并解決版圖中存在的問題，保證版圖的準(zhǔn)確性和可靠性。
3.根據(jù)后仿真結(jié)果，深入分析版圖對電路性能的影響，針對性地進(jìn)行版圖優(yōu)化。
4.與模擬電路設(shè)計工程師保持密切、高效的溝通，深入理解電路設(shè)計需求，確保版圖設(shè)計與電路設(shè)計完美契合。在項目推進(jìn)過程中，及時反饋版圖設(shè)計中的問題和建議，共同解決技術(shù)難題。
5.負(fù)責(zé)撰寫詳細(xì)、準(zhǔn)確的版圖設(shè)計相關(guān)文檔，包括設(shè)計報告、驗證報告等，完整記錄版圖設(shè)計過程和結(jié)果，為后續(xù)項目提供參考和依據(jù)。
任職要求：
1.集成電路、微電子、電子信息工程、應(yīng)用物理等相關(guān)專業(yè)本科及以上學(xué)歷。
2.熟練掌握Cadence Virtuoso等版圖設(shè)計工具，以及Calibre等版圖驗證工具。具有3年以上模擬芯片版圖設(shè)計工作經(jīng)驗，具有28nm CMOS版圖設(shè)計與工程投產(chǎn)經(jīng)驗。
3.具備良好的問題解決能力和團(tuán)隊協(xié)作精神，能夠高效工作，善于溝通與協(xié)調(diào)，確保項目的順利推進(jìn)。