FPGA工程師(J14796)
20元以上
深圳
應(yīng)屆畢業(yè)生
學(xué)歷不限
深圳
應(yīng)屆畢業(yè)生
學(xué)歷不限
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
2026-02-04 21:38:08
1850人關(guān)注
職位描述
該職位還未進(jìn)行加V認(rèn)證，請(qǐng)仔細(xì)了解后再進(jìn)行投遞！
工作職責(zé):
1.參與FPGA的資源評(píng)估及方案設(shè)計(jì)；
2.負(fù)責(zé)FPGA模塊代碼的編寫、調(diào)試和問題定位及版本維護(hù)；
3.負(fù)責(zé)FPGA設(shè)計(jì)文檔和測(cè)試報(bào)告的撰寫；
4.參與FPGA的資源優(yōu)化和時(shí)序優(yōu)化工作。
任職資格:
1、本科及以上學(xué)歷，電子、微電子、通信、計(jì)算機(jī)等相關(guān)專業(yè)；
2、熟悉Verilog/VHDL語言，熟悉Vivado/ISE/QuartusI/Matlab工具優(yōu)先；
3、對(duì)FPGA有較高的熱情，具備良好的溝通協(xié)作能力，抗壓能力強(qiáng)。
1.參與FPGA的資源評(píng)估及方案設(shè)計(jì)；
2.負(fù)責(zé)FPGA模塊代碼的編寫、調(diào)試和問題定位及版本維護(hù)；
3.負(fù)責(zé)FPGA設(shè)計(jì)文檔和測(cè)試報(bào)告的撰寫；
4.參與FPGA的資源優(yōu)化和時(shí)序優(yōu)化工作。
任職資格:
1、本科及以上學(xué)歷，電子、微電子、通信、計(jì)算機(jī)等相關(guān)專業(yè)；
2、熟悉Verilog/VHDL語言，熟悉Vivado/ISE/QuartusI/Matlab工具優(yōu)先；
3、對(duì)FPGA有較高的熱情，具備良好的溝通協(xié)作能力，抗壓能力強(qiáng)。
注：聯(lián)系我時(shí)，請(qǐng)說是在江蘇人才網(wǎng)上看到的。
工作地點(diǎn)
地址：深圳福田區(qū)中航城君尚購物中心D區(qū)
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職位發(fā)布者
陳誠(chéng)/招..HR
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